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	Added SIMLIB_NOSR to simlib.v
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									d4a1b0af5b
								
							
						
					
					
						commit
						e24797add0
					
				
					 1 changed files with 6 additions and 0 deletions
				
			
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					@ -977,6 +977,7 @@ end
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endmodule
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					endmodule
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			||||||
// --------------------------------------------------------
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					// --------------------------------------------------------
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			||||||
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					`ifndef SIMLIB_NOSR
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module \$sr (SET, CLR, Q);
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					module \$sr (SET, CLR, Q);
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			||||||
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			||||||
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						 | 
					@ -1003,6 +1004,7 @@ endgenerate
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			||||||
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endmodule
 | 
					endmodule
 | 
				
			||||||
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			||||||
 | 
					`endif
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			||||||
// --------------------------------------------------------
 | 
					// --------------------------------------------------------
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			||||||
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 | 
				
			||||||
module \$dff (CLK, D, Q);
 | 
					module \$dff (CLK, D, Q);
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			||||||
| 
						 | 
					@ -1022,6 +1024,7 @@ end
 | 
				
			||||||
endmodule
 | 
					endmodule
 | 
				
			||||||
 | 
					
 | 
				
			||||||
// --------------------------------------------------------
 | 
					// --------------------------------------------------------
 | 
				
			||||||
 | 
					`ifndef SIMLIB_NOSR
 | 
				
			||||||
 | 
					
 | 
				
			||||||
module \$dffsr (CLK, SET, CLR, D, Q);
 | 
					module \$dffsr (CLK, SET, CLR, D, Q);
 | 
				
			||||||
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 | 
				
			||||||
| 
						 | 
					@ -1053,6 +1056,7 @@ endgenerate
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			||||||
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endmodule
 | 
					endmodule
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			||||||
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			||||||
 | 
					`endif
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			||||||
// --------------------------------------------------------
 | 
					// --------------------------------------------------------
 | 
				
			||||||
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 | 
				
			||||||
module \$adff (CLK, ARST, D, Q);
 | 
					module \$adff (CLK, ARST, D, Q);
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			||||||
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						 | 
					@ -1096,6 +1100,7 @@ end
 | 
				
			||||||
endmodule
 | 
					endmodule
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			||||||
 | 
					
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			||||||
// --------------------------------------------------------
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					// --------------------------------------------------------
 | 
				
			||||||
 | 
					`ifndef SIMLIB_NOSR
 | 
				
			||||||
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			||||||
module \$dlatchsr (EN, SET, CLR, D, Q);
 | 
					module \$dlatchsr (EN, SET, CLR, D, Q);
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			||||||
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 | 
				
			||||||
| 
						 | 
					@ -1127,6 +1132,7 @@ endgenerate
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			||||||
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 | 
				
			||||||
endmodule
 | 
					endmodule
 | 
				
			||||||
 | 
					
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			||||||
 | 
					`endif
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			||||||
// --------------------------------------------------------
 | 
					// --------------------------------------------------------
 | 
				
			||||||
 | 
					
 | 
				
			||||||
module \$fsm (CLK, ARST, CTRL_IN, CTRL_OUT);
 | 
					module \$fsm (CLK, ARST, CTRL_IN, CTRL_OUT);
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